9.2.4 TX Power Ramping
To optimize the output power spectral density (PSD), the PA buffer and PA are enabled
sequentially, see in Figure 9-4 . In this example the transmission is initiated with the
rising edge of pin 11 (SLP_TR). The radio transceiver state changes from PLL_ON to
BUSY_TX. The modulation of the frame starts 16μs after SLP_TR rising edge.
9.2.5 Register Description
Register 0x05 (PHY_TX_PWR):
The PHY_TX_PWR register controls the output power of the transmitter.
Figure 9-5 . Register PHY_TX_PWR.
Bit
0x05
Read/Write
Reset value
Bit
0x05
Read/Write
Reset value
7
R
0
3
R/W
0
6
R/W
0
2
R/W
0
reserved
TX_PWR
5
R
0
1
R/W
0
4
R
0
0
R/W
0
PHY_TX_PWR
PHY_TX_PWR
? Bit 3:0 – TX_PWR
The register bits TX_PWR determine the TX output power of the radio transceiver.
Table 9-4. TX Output Power.
104
AT86RF232
Register Bits
TX_PWR
Value
0x0
0x1
0x2
0x3
0x4
0x5
0x6
0x7
0x8
0x9
0xA
0xB
0xC
0xD
0xE
0xF
TX Output Power [dBm]
+3.0
+2.8
+2.3
+1.8
+1.3
+0.7
0.0
-1
-2
-3
-4
-5
-7
-9
-12
-17
8321A – MCU Wireless – 10/11
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